A 3-ns 1-Kbit RAM Using Super Self-Aligned Process Technology

論文・著書情報

タイトル

和文:
英文:	A 3-ns 1-Kbit RAM Using Super Self-Aligned Process Technology

著者

和文:	Tetsushi Sakai, Y. Yamamoto, Y. Kobayashi, K. Kawarada, Y. Inabe, T. Hayashi, H. Miyanaga.
英文:	Tetsushi Sakai, Y. Yamamoto, Y. Kobayashi, K. Kawarada, Y. Inabe, T. Hayashi, H. Miyanaga.

言語

English

掲載誌/書名

和文:
英文:	IEEE Trans. on Solid-State Circuits

巻, 号, ページ

Vol. SC-16 No. 5 pp. 424-429

出版年月

1981年

出版者

和文:
英文:

会議名称

和文:
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開催地

和文:
英文: